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자일링스, 새로운 타깃 디자인 플랫폼 위한 차세대 FPGA 제품군 출시

자일링스가 자사의 플래그십 고성능 버텍스 및 저가의 스파르탄 FPGA의 차세대 제품을 발표했다. 이는 시스템 디자이너가 생산성을 높이고 개발 비용을 최소화할 수 있도록 하는 차세대 ‘타깃 디자인 플랫폼’의 토대를 제공한다.

버텍스-6와 스파르탄-6의 FPGA 제품군은 25년간 쌓아온 자일링스의 시장과 10세대를 넘는 FPGA 기술의 리더십에 기반하고 있다. 이 새로운 제품군은 오토모티브, 컨슈머, 유/무선 통신 시장에서 항공우주 및 국방에 이르기까지 다양한 엔드 마켓에서의 더 높은 대역폭과 뛰어난 성능, 보다 낮은 가격과 전력에 대한 끊임없는 세계적인 요구에 대응하기 위해 UMC와 새로운 파운드리 파트너 삼성으로부터 검증된 첨단 공정기술의 성능과 비용 상의 이점들을 활용한다.

프로그래머블의 필수화
무어의 법칙처럼 칩 밀도와 성능이 높아지면 개발과 제조상의 복잡함도 증가하기 때문에, 업계는 기존 ASIC과 ASSP 대신 차세대 시스템 설계로 FPGA를 채택하는 비율이 점점 더 높아지고 있다. 실제로 가트너(Gartner)는 2008년 FPGA 디자인과 ASIC 디자인의 비율이 25:1일 것으로 예상한다. 이는 프로그래머블 필수화 추세를 분명히 드러내는 것으로, 가트너는 앞으로도 이 추세가 계속 이어질 것으로 내다보고 있다.

프로그래머블 필수화 문제를 다루려면 두 가지 측면에서 노력이 필요하다. 우선 FPGA를 측정하는 모든 핵심 지수(가격, 전력, 성능, 밀도, 기능, 프로그래머빌리티)에서 업계를 선도하는 가치를 제공하는 프로그래머블 실리콘 혁신을 제공해야 한다. 두 번째는 FPGA가 빠른 시장 출시와 유연성을 보장할 수 있도록 전자 시스템을 구축하는 사람들에게 툴, 방법론 및 IP를 제공하는 것이다.

자일링스의 FPGA 디바이스를 제외한 각 구성요소는 자일링스나 써드파티 네트워크를 통해 제공되며, 디자인 서비스 전문가의 견고한 에코시스템을 통한 지원을 받는다. 타깃 디자인 플랫폼을 통해 소프트웨어/하드웨어 디자이너는 공개 표준, 공통 디자인 방법론, 개발 툴, 런타임 플랫폼을 활용할 수 있다. 이로 인해 디자이너는 애플리케이션 인프라 개발 시간을 단축할 수 있고, 최종 애플리케이션에 추가할 기능을 차별화하는데 더 많은 시간을 투자할 수 있다.

자일링스 버텍스-6 및 스파르탄-6 FPGA 제품군
UMC와 삼성의 최신 공정 기술을 사용한 구성 가능한 하드 IP와 프로그래머블 로직을 혼용하여, 버텍스-6과 스파르탄-6 FPGA는 이전 제품군에 비해 절반의 전력으로 두 배의 성능을 낼 수 있다. 자일링스는 고객에게 최고의 기술 솔루션을 제공하기 위해 다수의 파운드리를 이용하고 있다. 두 파운드리는 자일링스 전략에 따라 전력, 성능, 가격을 최적화하며, 저전력과 진보된 프로세서 기술을 갖춘 안정되고 검증된 제조사로 업계에서 인식되고 있다.

최대 760K 로직 밀도와 38Mbit 이상의 BlockRAM, 2,000 DSP 슬라이스를 갖춘 새로운 자일링스 디바이스들은 온-칩 성능에서 새로운 벤치마크를 설정하고 있다. 또한, 이 제품군은 11.2Gbps까지 동작하는 최대 64개의 GTH 트랜스버를 제공함으로써, 옵티컬 트랜스포트 시장을 위한 OTU(옵티컬 트랜스포트 유닛) 사양, 루트 포트 기능을 지원하는 PCI® 익스프레스 규격의 하드 블록, 전용 DDR3 메모리 컨트롤러 등을 지원한다. 이러한 기능들은 설계 팀이 백플레인을 통해서나 광섬유나 구리를 통해서, 칩-투-칩 또는 최신 고속 메모리에 연결되는 시스템들을 함께 연결할 수 있도록 해준다. 새 디바이스 제품군을 통해, 시스템 디자이너는 100개 이상의 IP 코어, 자일링스 FPGA 제품군과 개발 플랫폼의 레퍼런스 디자인을 활용할 수도 있다.

아이씨엔 매거진 2009년 03월호

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